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五、準據法與管轄法院
本同意書之解釋與適用，以及本同意書有關之爭議，均應依照中華民國法律予以處理，並以臺灣臺北地方法院為管轄法院。
關於 蘇培陞講師
講師簡介
現職
成功大學電機系兼任副教授
最高學歷
美國加州大學河濱分校電腦科學博士
Alan P. Su received his doctorate from University of California Riverside in 1998. Between 1998 and 2002 he worked for EEsof, Hewlett-Packard Company, later spun off to become Agilent, to develop a DSP Synthesis tool and other Electronic System Level (ESL) tools. In 2003 he returned to Taiwan and joined SoC Technology Center, ITRI to conduct several ESL projects in tool development, SoC designing and design methodology. While remained as a consultant with ITRI, in April 2006 he joined SpringSoft, Inc. to lead the development of ESL tools. In August 2008 he joined Global Unichip Corp. to develop ESL development boards as platforms to provide ESL design services. In June 2011 he joined Synopsys to promote ESL methodology and tools. Currently he serves as the CEO in a new venture, architecting and delivering design services. Dr. Su is also an Adjunct Associate Professor with EE Department of National Cheng Kung University since Feb. 2013, teaching SystemC and ESL and conducting ESL related researches.
Dr. Su involves in various ESL standardization efforts. He was a member of OSCI (now part of Accellera) Transaction Level Modeling (TLM) Working Group, Synthesis Working Group, Configuration, Control and Inspection Working Group, Language Working Group and OCP-IP Debug Working Group. Since 2013 he is invited as the Accellera Representative to Taiwan Region, organize and host Accellera Users’ Group Forum in Taiwan.
Dr. Su's research interest includes distributed and parallel computing, embedded system design, 3D IC and ESL verification, synthesis, debug, testing and design methodology.
課程簡介
☛ 上課前言
Electronic System Level Design Methodology (ESL)，電子系統層級設計方法論，是開發嵌入式多核芯系統晶片重要且必要的設計技術。相對於傳統的RTL設計流程，ESL不僅可保證SoC 的設計品質，並能減少25%的開發時程。
此課程分成兩階段，第一階段講解ESL的標準設計及驗證語言SystemC (IEEE 1666-2011)。此階段從 SystemC 的基底語言 C/C++ 開始介紹，在課程中輔以 Verilog 的概念說明以 SystemC 建立硬體模組的理論及寫作，講解行為層級的模型建立的實用法門，最後簡介RISC-V指令集。
第二階段則以SoC設計概念及技巧的深入探討為開始，接著講解ESL的內涵及理論，其設計，如何以TLM 2.0來建立SoC模型，從而得以模擬驗證SoC軟硬體的正確性。瞭解了ESL技術的運用後，我們再講解Model-Based Design，這個在大陸及台灣都不被了解，但卻是SoC設計流程中極關鍵極重要的系統分析技術。
課程試看☛☛☛這裡
☛ 課前資訊
❶ 要先行準備的工具或軟體
☆ Linux 工作站。可在 Windows 或 iMac 上安裝 VirtualBox，再將 Linux 安裝於其上。任何 Linux 版本，如 RedHat, CentOS, Ubuntu, Suse 等等皆可。
☆ C++ Compiler。Linux 上隨附的 Gnu g++ compiler 即可。
☆ SystemC 2.3.3 library。請至 這裡 下載安裝
☆ GTKWave。請至 這裡 下載安裝。
☆ VLSI Design。 ☆ Digital Circuit Design。 ☆ Verilog。 ❸ 適合情境 ☆ 已有SoC實作經驗，準備進入Multi-core SoC 設計領域。 ☆ 至少使用 40nm 製程，或是要開始使用 22nm 或以上之先進製程。
☛ 課程介紹
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☆ 半導體技術進入40nm 製程之後，IC/SoC的設計已是多核芯的架構。
☆ 多核芯晶片的複雜度已難以用傳統 RTL 方法設計達成高效率高品質的要求。
☆ 後摩爾定律時代已迫在眉梢，其技術障礙已高到無法用傳統方法跨越。
☆ 多核芯系統的軟體複雜度更高過硬體設計，但在缺乏完整的設計方法的情況下，所開發的SoC品質不穩定且無法確知問題點所在。
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☆ 先進設計方法，即所謂的 ESL 設計方法 (Electronic System Level Design Methodology)，是解決設計開發多核芯SoC痛點的必要手段。
☆ 學習 ESL 之前，工程師必須要先具備 ESL 標準設計語言，SystemC 的能力。
☆ 本課程從SystemC的學習開始打基礎，繼之介紹SoC設計的理論及方法，再講解ESL設計方法論及其使用方法，完整的說明如何設計開發多核芯系統晶片。
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技巧
☆ SystemC 語言及其實用技巧。
☆ 硬體模組之行為層級模型建立理論及實作。
☆ ESL理論。
☆ ESL設計方法及實作。
工具
☆ Linux。
☆ C++ Compiler。
☆ SystemC 2.3.3 library。
☆ GTKWave。
☆ OVPsim。
☆ Imperas M*SDK (需付費)。
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☆ 蘇培陞博士自博士學程即開始ESL 理論的鑽研及實作，至今已超過20年。
☆ 蘇博士曾深度參與 SystemC TLM 2.0 及 Synthesizable Subset 的標準制定工作。
☆ 蘇博士已在成功大學電機系教授此課程8年。
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ESL技術雖已發展多年，但因為台灣及大陸半導體業界以追求摩爾定律的製程技術為主要目標，以致僅有以多核芯SoC為主要產品的歐美日半導體設計大廠深度使用ESL技術，反而在台灣及大陸並沒有大量使用。但在半導體製程已進入5nm量產，並一路不停往 3nm, 1nm 及後摩爾技術前進，多核芯SoC已是大陸及台灣大廠的產品主流，ESL技術已成為必要具備的技術。有鑑於此，我們製作了ESL課程，第一階段為SystemC, Behavior Coding & Modeling，講述ESL技術的標準設計語言 SystemC。
第二階段為 Electronic System Level Design Methodology，了解多核芯SoC設計為始，再講解如何使用ESL來設計並驗證多核芯系統晶片。
第一階段：SystemC, Behavior Coding & Modeling
此階段課程分成六個單元：
單元一：Brief Introduction to ESL
說明：簡短介紹ESL，讓學員了解為何要學習此課程。
單元二：C
說明：講解 SystemC 的基底語言ㄧ，C 的實用技巧，並配合兩個作業的練習。
單元三：C++
說明：講解 SystemC 的基底語言二，C++ 的實用技巧，並配合兩個作業的練習。
單元四：SystemC (IEEE 1666-2011)
說明：講解 SystemC 的理論及其實用技巧，並配合三個作業的練習。注意IEEE 1666-2011所包含的 TLM 2.0 於第二階段課程做講解
單元五：High Level Synthesis
說明：從 High Level Synthesis 的基本概念開始，講解行為層級硬體模組的設計及模型建立方法，並配合一個作業的練習。
單元六：RISC-V Base Instruction Set 2.0
說明：RISC-V為一開放原始碼的CPU精簡指令集 (RISC)，為RISC架構的創始人之一，美國加州柏克萊分校的David Peterson教授所領導開發的第五代RISC指令集架構。自RISC-V在2016年公開，在短短數年已發展出完整且免費的工具鏈 (toolchain)，非常適合支援 ESL 的教學平台。故此在進入第二階段課程之前，對RISC-V指令集做個簡介。
第二階段：Electronic System Level Design Methodology
此階段課程分成六個單元：
單元一：Introduction
說明：以美國國防部DARPA，ERI計畫，討論現在先進半導體設計所面臨的問題為引，說明多核芯系統晶片設計所遭遇的，軟硬體協同設計的困難，了解在後摩爾定律時代迫在眉梢的當下，學員為什麼要學習使用ESL。
單元二：System Design
說明：講解 SoC設計的概念，所面臨的硬體設計問題及普遍使用的解決方法，再經由平行運算及分散式運算的介紹與討論，了解多核芯軟體設計所面臨的難題。藉此單元，配合一個行為層級模組設計的作業，先行了解數位Silicon Intellectual Property (SIP)的建模方式。
單元三：TLM 2.0
說明：講解 SystemC 的子系統，Transaction Level Modeling v2.0，交易層級建模工具集 2.0 ，的理論及實用方法，並承接第一個作業，實作一個 TLM 2.0 模組。
單元四：Building The ESL Platform
說明：從ESL的理論開始，討論歐美日的系統設計概念，從而學習ESL的設計方法。此單元配合一個計畫作業，在 OVPsim中使用RISC-V模擬器，第二個作業的模組，及一個記憶體模組，配合 TLM 2.0 library來練習如何建立一個SoC模型。
單元五：Model-Based Design
說明：Model-Based Design 的基礎理論始於1956年，並在20世紀60年代至80年代有了數個革命性的突破。在現今後摩爾時代逼近所帶來的巨大SoC設計困難，Model-Based Design提供了不可或缺的設計方法，可有效解決軟硬體系統針對效能、耗能及成本上的設計難題。
單元六：Hardware Dependent Software
說明：經過這個課程的講解，我們已深切認知多核芯軟體所帶來的系統設計問題是有多麼困難。Hardware Dependent Software所揭櫫的軟體設計架構提供了一個提升設計效益的解決方案。
作業四，是雙核芯計畫作業，目的是經過實作，了解多核及多序 (multi-thread) 運算時的資料同步問題。所用的工具是 Imperas 商用M*SDK。此工具是 OVPsim 的加強版，必須購買取得。本課程並不提供此商用軟體，學員若要使用，請直接聯絡 Imperas (http://www.imperas.com/) 洽談。
授課大綱
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